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崗位職責(zé):1、負(fù)責(zé)顯示驅(qū)動(dòng)IC數(shù)字電路部分功能、需求定義，并能形成需求list check后續(xù)數(shù)字電路的實(shí)現(xiàn)；2、負(fù)責(zé)數(shù)字電路部分RTL代碼設(shè)計(jì)、仿真、驗(yàn)證、綜合等，輸出設(shè)計(jì)報(bào)告；3、負(fù)責(zé)各功能單元的時(shí)序設(shè)計(jì)及驗(yàn)證，并輸出時(shí)序仿真及驗(yàn)證報(bào)告；4、負(fù)責(zé)數(shù)字電路的布局布線及參數(shù)提取，包括時(shí)鐘線的布線，延遲信息等；5、負(fù)責(zé)回片測(cè)試的（含DVT測(cè)試，可靠性測(cè)試，ATE測(cè)試，產(chǎn)品測(cè)試）問題debug及重大問題攻關(guān)，保障測(cè)試進(jìn)度；任職要求:1、熟練掌握數(shù)字芯片設(shè)計(jì)語(yǔ)言，如verilog、system verilog，并能夠熟練使用設(shè)計(jì)工具，如UVM等；2、掌握接口協(xié)議，包括I2C，SPI，MIPI等，其中有對(duì)口數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮；3、熟悉使用FPGA驗(yàn)證平臺(tái)，并能夠通過Verilog語(yǔ)言設(shè)計(jì)算法，驗(yàn)證算法的可行性，如Demura等；4、熟悉shell、Perl、Tcl、Python等相關(guān)腳本語(yǔ)言；5、具備扎實(shí)的數(shù)字電路設(shè)計(jì)理論基礎(chǔ)； 職能類別：質(zhì)量管理/測(cè)試工程師(QA/QC工程師)